Verzweigte PCI-E-Port-Signalintegrität und Verbindungsgeschwindigkeitsfehler nach Bios-Mod

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david moheban

Mit Bifurkation zu experimentieren, und Sie scheinen gut informiert zu sein, also dachte ich, ich würde um Hilfe bei einem Problem bitten, das ich habe. Grundsätzlich besitze ich ein Msi X99a Godlike Motherboard und einen 6850k Prozessor. Ich habe herausgefunden, wie man das Bios "modt", damit der 8X-Port sich in zwei 4X-Ports verzweigen kann.

In jedem Fall bemerkte ich danach, dass mein plextor M8pey SSD NVME-Laufwerk, das in den letzten pcie 8x-Steckplatz eingesetzt wurde (der die Bandbreite mit dem integrierten M.2-Controller, der ein Samsung 950 pro hostet) verwendet, bei einem Neustart nach dem Zufallsprinzip nicht bei 8 gt / s Betrieb und bei 2.5 statt.

Also habe ich nach den möglichen Ursachen gesucht und nach Lösungen gesucht, beispielsweise dem Einstellen des Timeout-Timers für das Motherboard für Training-Latenzzeiten von 1000 bis 10000. Außerdem kann der Extended-Sync-Modus des IO-Controllers für diese Ports aktiviert werden, und es müssen nicht übereinstimmende L1-Ausgangslatenzwerte korrigiert werden.

Meistens bin ich in der Lage, zwei nvme-Antriebe außerhalb der cpu pcie lanes zu betreiben, wo dies nicht beabsichtigt war, aber da ich eine 40-spurige cpu habe, wollte ich nicht, dass die extra lanes weggeworfen werden. Erwähnt werden sollte auch die Verwendung eines Supermicro RSC-R2UU-2E4R 2U 8x-zu-4x4x-Adapters, um die letzten 4 nicht verwendeten Spuren zu erreichen. Dieses Geschwindigkeitsproblem tritt jedoch mit oder ohne Adapter auf.

Meine beste Vermutung ist, dass der Bus mit allen Peripheriegeräten einschließlich zwei Grafikkarten bei 16X sehr laut ist. Da ich kein mit pcie tech vertrauter Bios-Ingenieur bin, habe ich mich gefragt, ob jemand mit mehr Wissen Ratschläge geben könnte. Fragen Sie sich auch, ob die Änderung der PCI-E-Taktquelle im BIOS für diesen Port in "Distinct" oder "Separate" hilfreich sein könnte.

Vielen Dank

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